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| @ CHECK: vld4.16 {d17[], d18[], d19[], d20[]}, [r7]! @ encoding: [0x6d,0x1f,0xe7,0xf4] |
| @ CHECK: vld4.32 {d16[], d18[], d20[], d22[]}, [r8]! @ encoding: [0xad,0x0f,0xe8,0xf4] |
| @ CHECK: vld4.8 {d16[], d17[], d18[], d19[]}, [r1], r8 @ encoding: [0x08,0x0f,0xe1,0xf4] |
| @ CHECK: vld4.16 {d16[], d17[], d18[], d19[]}, [r2], r7 @ encoding: [0x47,0x0f,0xe2,0xf4] |
| @ CHECK: vld4.32 {d16[], d17[], d18[], d19[]}, [r3], r5 @ encoding: [0x85,0x0f,0xe3,0xf4] |
| @ CHECK: vld4.8 {d16[], d18[], d20[], d22[]}, [r6], r3 @ encoding: [0x23,0x0f,0xe6,0xf4] |
| @ CHECK: vld4.16 {d16[], d18[], d20[], d22[]}, [r6], r3 @ encoding: [0x63,0x0f,0xe6,0xf4] |
| @ CHECK: vld4.32 {d17[], d19[], d21[], d23[]}, [r9], r4 @ encoding: [0xa4,0x1f,0xe9,0xf4] |
| |
| @ Handle 'Q' registers in register lists as if the sub-reg D regs were |
| @ specified instead. |
| vld1.8 {q3}, [r9] |
| vld1.8 {q3, q4}, [r9] |
| |
| @ CHECK: vld1.8 {d6, d7}, [r9] @ encoding: [0x0f,0x6a,0x29,0xf4] |
| @ CHECK: vld1.8 {d6, d7, d8, d9}, [r9] @ encoding: [0x0f,0x62,0x29,0xf4] |
| |
| |
| @ Spot-check additional size-suffix aliases. |
| vld1.8 {d2}, [r2] |
| vld1.p8 {d2}, [r2] |
| vld1.u8 {d2}, [r2] |
| |
| vld1.8 {q2}, [r2] |
| vld1.p8 {q2}, [r2] |
| vld1.u8 {q2}, [r2] |
| vld1.f32 {q2}, [r2] |
| |
| vld1.u8 {d2, d3, d4}, [r2] |
| vld1.i32 {d2, d3, d4}, [r2] |
| vld1.f64 {d2, d3, d4}, [r2] |
| |
| @ CHECK: vld1.8 {d2}, [r2] @ encoding: [0x0f,0x27,0x22,0xf4] |
| @ CHECK: vld1.8 {d2}, [r2] @ encoding: [0x0f,0x27,0x22,0xf4] |
| @ CHECK: vld1.8 {d2}, [r2] @ encoding: [0x0f,0x27,0x22,0xf4] |
| |
| @ CHECK: vld1.8 {d4, d5}, [r2] @ encoding: [0x0f,0x4a,0x22,0xf4] |
| @ CHECK: vld1.8 {d4, d5}, [r2] @ encoding: [0x0f,0x4a,0x22,0xf4] |
| @ CHECK: vld1.8 {d4, d5}, [r2] @ encoding: [0x0f,0x4a,0x22,0xf4] |
| @ CHECK: vld1.32 {d4, d5}, [r2] @ encoding: [0x8f,0x4a,0x22,0xf4] |
| |
| @ CHECK: vld1.8 {d2, d3, d4}, [r2] @ encoding: [0x0f,0x26,0x22,0xf4] |
| @ CHECK: vld1.32 {d2, d3, d4}, [r2] @ encoding: [0x8f,0x26,0x22,0xf4] |
| @ CHECK: vld1.64 {d2, d3, d4}, [r2] @ encoding: [0xcf,0x26,0x22,0xf4] |
| |
| |
| @ Register lists can use the range syntax, just like VLDM |
| vld1.f64 {d2-d5}, [r2:128]! |
| vld1.f64 {d2,d3,d4,d5}, [r2:128]! |
| |
| @ CHECK: vld1.64 {d2, d3, d4, d5}, [r2:128]! @ encoding: [0xed,0x22,0x22,0xf4] |
| @ CHECK: vld1.64 {d2, d3, d4, d5}, [r2:128]! @ encoding: [0xed,0x22,0x22,0xf4] |
| |
| |
| @ verify that the old incorrect alignment specifier syntax (", :") |
| @ still gets accepted. |
| vld2.8 {d16, d17}, [r0, :64] |
| vld2.16 {d16, d17}, [r0, :128] |
| |
| @ CHECK: vld2.8 {d16, d17}, [r0:64] @ encoding: [0x1f,0x08,0x60,0xf4] |
| @ CHECK: vld2.16 {d16, d17}, [r0:128] @ encoding: [0x6f,0x08,0x60,0xf4] |
